机译:采用非线性双插值技术的0.13-μm数字CMOS工艺中的嵌入式0.8 V / 480 MW 6b / 22 MHz闪存ADC
机译:基于CMOS 45nm技术的UP-DOWN计数器作为基于SAR逻辑的ADC的优化设计
机译:基于45nm CMOS技术的ECG低功耗SAR ADC设计
机译:0.45pj / conv-steet 1.2gs / s 6b全奈奎斯特非校准的闪光ADC,45nm CMOS及其缩放行为
机译:具有45nm CMOS SOI技术的具有32:1串行器的2位1Gsps ADC阵列
机译:采用45nm CmOs的0.45pJ / conv-step 1.2Gs / s 6b全奈奎斯特非校准闪存aDC及其缩放行为